Per iniziare

Scopri esempi, video e tutorial di sistemi ibridi.

Fase 1: Introduzione alla modellazione di segnali ibridi
Che cos’è Mixed-Signal Blockset?
Progetta e simula sistemi analogici e di segnali misti come ADC e PLL con Mixed-Signal Blockset.

Video
Che cos’è SerDes Toolbox?
Progetta sistemi SerDes e genera modelli IBIS-AMI per interconnessioni ad alta velocità come DDR, PCI Express ed Ethernet utilizzando SerDes Toolbox.

Video
Che cos’è Simscape Electrical?
Modella e simula sistemi elettronici, meccatronici e di alimentazione elettrica con Simscape Electrical.

Video
Che cos’è HDL Coder?
HDL Coder consente la progettazione di alto livello per FPGA, SoC e ASIC generando codice Verilog e VHDL. Il codice HDL generato può essere utilizzato per la programmazione FPGA, la prototipazione ASIC e la progettazione di produzione.

Video
Progettazione e verifica di PLL utilizzando le specifiche delle schede tecniche tra cui il rumore di fase
Utilizza Mixed-Signal Blockset per modellare un PLL a N intero commerciale pronto all’uso con prescaler a modulo doppio che opera intorno ai 4 GHz. Verifica le prestazioni del PLL, tra cui il rumore di fase, i tempi di blocco e la frequenza operativa.

Video
Flusso di progettazione Model-Based a segnali misti per sensori automotive
Allegro Microsystems spiega come è in grado di sfruttare MATLAB e Simulink per accelerare la prototipazione, semplificare la verifica basata su UVM e automatizzare la generazione di codice RTL per IC di sensori a segnali misti.

Video

Modelli di Mixed-Signal Blockset
Modelli di Mixed-Signal Blockset
I modelli di Mixed-Signal Blockset forniscono modelli ed esempi aggiuntivi di sistemi tipici come PLL, ADC, SerDes e SMPS mettendo in evidenza l’integrazione analogico/digitale.

Prodotto aggiuntivo

Progettazione e valutazione di un modello di PLL semplice
Progettazione e valutazione di un modello di PLL semplice
Questo esempio mostra come progettare un semplice PLL utilizzando un’architettura di riferimento e validare il PLL utilizzando PLL Testbench.

Documentazione

Effetto del problema della metastabilità in un ADC flash
Effetto del problema della metastabilità in un ADC flash
Questo esempio mostra come personalizzare un ADC flash aggiungendo la probabilità di metastabilità come disturbo e come misurare quest’ultimo.

Documentazione

Fase 2: Modellazione analogica con Simscape
Applicazioni e attività in Simscape Electrical
Progetta sistemi meccatronici con Simscape Electrical. Un attuatore elettromeccanico e un veicolo elettrico ibrido mostrano il valore della simulazione in un processo di progettazione.

Video
Simulazione in tempo reale: attuatore elettrico
Converti un modello di attuatore meccatronico in codice C e simula in una configurazione Hardware-In-the-Loop. I parametri di Simscape sono regolati in base al target in tempo reale.

Video

Convertitore analogico-digitale di un condensatore commutato
Convertitore analogico-digitale di un condensatore commutato
Questo esempio mostra come un ADC (convertitore analogico-digitale) sigma-delta utilizza la modulazione sigma-delta per convertire un segnale di input analogico in un segnale di output digitale.

Esempio

Modellazione di Sistemi Fisici con Simscape
Modellazione di sistemi fisici con Simscape
Questo corso di un giorno è incentrato sulla modellazione di sistemi in diversi domini fisici e sulla loro combinazione in un sistema multidominio nell’ambiente Simulink utilizzando Simscape.

Formazione a pagamento

Fase 3: Progettazione digitale con generazione di codice HDL
Progettazione FPGA con MATLAB (5 video)
Guarda questo video suddiviso in cinque parti per saperne di più sulla progettazione FPGA con MATLAB. Scopri quali sono gli elementi più importanti da prendere in considerazione per il targeting di un algoritmo di elaborazione di segnali su hardware FPGA o ASIC.

Video
Generazione di codice HDL a virgola mobile per hardware FPGA e ASIC
Generazione di codice VHDL o Verilog sintetizzabile e indipendente dalla destinazione direttamente da modelli a virgola mobile a precisione singola, doppia o mezza.

Video
La virgola fissa per la programmazione FPGA diventa più semplice
Impara le nozioni base della matematica a virgola fissa e come applicare queste conoscenze per implementare il tuo progetto in modo efficiente su hardware FPGA.

Video

Instructor-Led Training

DSP per FPGA
DSP per FPGA
In queste tre giornate di corso ripasseremo i concetti fondamentali relativi ai DSP dal punto di vista dell’implementazione nella struttura interna di un FPGA.

Instructor-Led Training

Fase 4: Panoramica della verifica di segnali ibridi
Che cos’è HDL Verifier?
Testa e verifica progettazioni per FPGA, ASIC e SoC con HDL Verifier. Verifica RTL con test bench in MATLAB o Simulink utilizzando la cosimulazione con simulatori HDL. Usa questi test bench con le schede di sviluppo per verificare le implementazioni HDL nell’hardware.

Video
Generazione di SystemVerilog DPI per la verifica di sistemi di segnali misti e analogici
Esportazione di modelli Simulink analogici/di segnali misti nel simulatore di SystemVerilog.

Video
Importazione di codice HDL per la co-simulazione con Simulink
Utilizzo di HDL Verifier per importare codice VHDL o Verilog precedente o scritto a mano per la co-simulazione con Simulink.

Video
Co-simulazione di modelli SPICE con Cadence Spectre
Linee guida per iniziare a utilizzare HDL Coder per il tuo progetto, inclusi esempi specifici su determinati concetti.

Video
Progettazione PLL con MATLAB e Simulink
Le simulazioni PLL sono spesso lente e allungano i tempi di sviluppo del progetto. Per velocizzare la progettazione PLL, gli ingegneri utilizzano gli strumenti di MathWorks. Questi strumenti modellano il feedback in modo efficiente, consentono di simulare insieme componenti analogici e digitali e prevedono una modellazione astratta.

Video

Questo esempio mostra come costruire un test bench comportamentale utilizzando la generazione di componenti DPI-C di SystemVerilog.
Questo esempio mostra come costruire un test bench comportamentale utilizzando la generazione di componenti DPI-C di SystemVerilog.
Questo esempio mostra come costruire un test bench comportamentale utilizzando la generazione di componenti DPI-C di SystemVerilog.

Esempio

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